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高速電路信號完整性分析與設計—信號完整性仿真

2009-10-06 | rar | 344 | 次下載 | 免費

資料介紹

高速電路信號完整性分析與設計—信號完整性仿真:仿真信號
仿真中有兩類信號可稱之為高速信號:
??高頻率的信號(>=50M)
??上升時間tr很短的信號:
信號上升沿從20%~80%VCC的時間,一般是ns級或ps級快速邊緣信號對信號完整性的影響
??更大的SSN
??更大的Crosstalk
??更大的EMI
仿真任務
1、對時鐘同步信號,仿真信號時序及信號質量,滿足信號的建立時間、保持時間、小的過沖與振蕩;
2、對異步信號,仿真信號質量,滿足信號的單調性、過沖容限及小的振蕩;
3、對平行走線的信號,仿真串擾,確定容忍的平行長度;
仿真原則
在仿真中,不能按典型情況仿真(Typical),必須按最惡劣情況(Worst Case)仿真,必須滿足Datasheet中的最大最小值。
高速數字設計方法
高速數字設計方法
后仿真:
實際布線后的仿真,用于驗證、檢驗仿真結果,是更加精確的仿真, 使用的是實際的布線參數。前仿真是按照理想的傳輸線來仿真的,而且前仿真只考慮了單網絡的反射效應,沒有也沒辦法將鄰近傳輸線的串擾等因素考慮進來,另外在實際布線中會有穿層,導致阻抗的變化以及增加過孔等,這些都是在前仿真中無法計算進去的。因此在單板布線完成后,對一些關鍵的網絡需要進行后仿真來驗證,若后仿真不能滿足時序的要求,那么需要對這類線進行重新仿真與布線,若布線空間已經很小,則可能要對板子的局部范圍甚至整個板子重新布線。
仿真工具
Cadence公司與Mentor的的EDA軟件,如Cadence公司的SpecctraQuest和SigXplor設計工具,這些工具可以仿真實際PCB設計中的各種物理參數,對系統中的信號完整性和時序(TIming),串擾(Crosstalk)、EMI問題進行定量的分析。但是,對于1GHz以上的高速互連系統,仿真模型的精度問題成為主要問題。
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